職責描述： 1. 使用SV和C語言參與負責驗證用例開發(fā)，調試以及問題定位 2. 參與負責芯片系統(tǒng)及單元模塊UVM驗證平臺的搭建和維護 3. 輸出相關的驗證文檔，如驗證需求/驗證方案/驗證計劃/驗證報告 4. 與設計團隊緊密合作，推動設計達到驗證收斂 任職要求： 1. 微電子、電子、計算機、軟件、自動化等專業(yè)本科以上 2. 在學期間有FPGA開發(fā)等Verilog經驗優(yōu)先 3. 熟悉Python/Perl/Tcl等腳本語言的經驗優(yōu)先 4. 熟悉C或C++等一種或多種編程語言優(yōu)先 5. 熟悉計算機網絡協(xié)議相關內容的優(yōu)先 6. 具備流利的英文讀寫能力。

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